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イーサネット/USB 2.0 ホストが付いている LPC1752 腕 32 ビット開発板 64 KB SRAM

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中国 N&S ELECTRONIC CO., LIMITED 認証
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イーサネット/USB 2.0 ホストが付いている LPC1752 腕 32 ビット開発板 64 KB SRAM

イーサネット/USB 2.0 ホストが付いている LPC1752 腕 32 ビット開発板 64 KB SRAM

説明
P ・ N: LPC1752 タイプ: 32ビット腕皮質 M3 MCU
ハイライト:

腕の皮質の開発板

,

マイクロ制御回路開発板

512 kbのフラッシュおよびイーサネット、USB 2.0のホスト/Device/OTGの64 kbまでのLPC1752 32ビット腕皮質M3 MCUはSRAM、できます

 

 

1. 概説

 


LPC1758/56/54/52/51は埋め込まれるのための腕の皮質M3によって基づくマイクロ制御回路です
統合および低い電力の消費の高レベルを特色にする適用。腕
皮質M3は高められるのようなシステム強化を提供する次世代の中心です
サポート ブロックの統合の特徴そして高レベルをデバッグして下さい。
LPC1758/56/54/52/51は100つまでのMHzのCPUの頻度で作動します。腕
皮質M3 CPUは3段階のパイプラインを織込み、ハーバード建築をとの使用します
ペリフェラルのためのローカル指示およびデータ・バス、また第3バスを分けて下さい。腕
皮質M3 CPUはまた推測的支える内部先取りの単位を含んでいます
ブランチ命令。
LPC1758/56/54/52/51の周辺補足物はflの灰の512までkbを含んでいます
記憶、データ記憶、イーサネットMACのUSB装置/Host/OTGインターフェイスの64までkb、
8チャンネルの一般目的のDMAコントローラー、4つのUARTs、2はチャネル、2つのSSPのコントローラーできます、
SPIインターフェイス、3 I
2
Cバス インターフェイス、2出力Iと2入力
2
Sバス インターフェイス、6チャネル
12ビットADCの10ビットDACの運動制御PWMの求積法のエンコーダー インターフェイス、4概要
タイマー、6出力一般目的PWMの超低い力の実時間時計(RTC)を意図して下さい
別々のバッテリーの供給および52までの一般目的入力/出力ピンを使って
 

2. 特徴

 


100つまでのMHzの頻度で動く皮質M3プロセッサを武装させて下さい。記憶
8つの地域を支える保護単位(MPU)は含まれています。
I
作り付け皮質M3を入り込みました(NVIC)方向を変えられた割り込みコントローラに武装させて下さい。
I
512 kbまでオン破片のflの灰のプログラミングの記憶。高められたflの灰の記憶加速装置
ゼロ待ち状態との高速100つのMHz操作を可能にします。
I
(ISP)をプログラムするオン破片によって(IAP)をプログラムする内部システムおよび内部適用
ブート・ローダ ソフトウェア。
I
オン破片SRAMは下記のものを含んでいます:
N
高性能のための局所コード/データ・バスが付いているCPUのSRAMの32までkb
CPUのアクセス。
N
2/1より高い効率のための別のアクセス パスが付いている16のkb SRAMのブロック。
これらのSRAMのブロックはイーサネット(LPC1758だけ)、USBおよびDMAに使用するかもしれません
一般目的CPUの指示およびデータ記憶のための記憶、また。
I
8つのチャネルの多層AHBの一般目的のDMAコントローラー(GPDMA)
SSPと使用することができるマトリックスI
2
Sバス、UARTのアナログ-デジタル
デジタル アナログ変換器ペリフェラル、タイマーのマッチ信号、およびのための
記憶に記憶移動。
 

イーサネット/USB 2.0 ホストが付いている LPC1752 腕 32 ビット開発板 64 KB SRAM 0

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